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LEADER |
00000cam a2200000 4500 |
008 |
000000n 000 0 eng u |
035 |
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|a (Sirsi) a273313
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084 |
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|a IEC90
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100 |
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|a Pérez Tellez, Silvia
|
245 |
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|a Diseño y simulación de un circuito integrado codificador de línea usando la métodologia de lógica de arreglos programables (pal).
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260 |
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|a Poza Rica
|b : Facultad de Ingeniería, Universidad Veracruzana,
|c 1988
|
300 |
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|a 98 p.
|b :il.
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502 |
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|a Tesis (Ingeniero en Electrónica y Comunicaciones) -- Universidad Veracruzana.
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653 |
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|a Ingeniero en Electrónica y Comunicaciones.
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596 |
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|a 2
|
942 |
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|c TESIS
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999 |
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|c 89006
|d 89006
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